Loopback functionality is provided

Loopback functionality is provided as either MAC RX to TX (loopback logic replaces the packet generator as the packet source), or PHY TX to RX (loopback logic replaces the demonstration test bench stimulus and checker). Push buttons and DIP switches on the board provide basic control of the state machine allowing Ethernet MAC bit rate change. See the board-specific sections in Targeting the Example Design to a Board. The following figure illustrates the top-level of the AXI Ethernet Subsystem HDL example design.

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环回功能可作为 MAC RX 到 TX（环回逻辑取代数据包生成器作为数据包源）或 PHY TX 到 RX（环回逻辑取代演示测试台激励和检查器）提供。板上的按钮和 DIP 开关提供状态机的基本控制，允许更改以太网 MAC 比特率。请参阅将示例设计定位到电路板中特定于电路板的部分。下图说明了 AXI 以太网子系统 HDL 示例设计的顶层。

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环回功能提供为MAC RX到TX（环回逻辑取代数据包生成器作为数据包源）或PHY TX到RX（环返逻辑取代演示测试台激励和检查器）。板上的按钮和DIP开关提供对状态机的基本控制，允许以太网MAC比特率更改。请参阅以板为目标的示例设计中的板特定部分。下图说明了AXI以太网子系统HDL示例设计的顶层。

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环回功能以MAC RX到TX(环回逻辑取代数据包生成器作为数据包源)或PHY TX到RX(环回逻辑取代演示测试平台激励和检查器)的形式提供。板上的按钮和DIP开关提供状态机的基本控制，允许以太网MAC比特率更改。请参阅将示例设计定位到电路板中的电路板特定部分。下图说明了AXI以太网子系统HDL示例设计的顶层。

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