When the core is configured to use

When the core is configured to use GMII or RGMII interface on UltraScale or UltraScale+ devices,you need to set the REFCLK_FREQUENCY attribute of all the IDELAY and ODELAY primitives used by the core to the frequency of the clock driving the ref_clk port. This can be done through XDC constraints. For more information, refer to the example design in Vivado.

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当内核配置为在 UltraScale 或 UltraScale+ 器件上使用 GMII 或 RGMII 接口时，需要将内核使用的所有 IDELAY 和 ODELAY 原语的 REFCLK_FREQUENCY 属性设置为驱动 ref_clk 端口的时钟频率。这可以通过 XDC 约束来完成。有关更多信息，请参阅 Vivado 中的示例设计。

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当核心配置为在UltraScale或UltraScale+设备上使用GMII或RGMII接口时，您需要将核心使用的所有IDELAY和ODELAY原语的REFCLK_FREQUENCY属性设置为驱动ref_clk端口的时钟频率。这可以通过XDC约束来实现。有关更多信息，请参阅Vivado中的示例设计。

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当内核配置为在UltraScale或UltraScale+器件上使用GMII或RGMII接口时，需要将内核使用的所有IDELAY和ODELAY原语的REFCLK_FREQUENCY属性设置为驱动ref_clk端口的时钟频率。这可以通过XDC约束来实现。更多信息，请参考Vivado中的示例设计。

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