Because the subsystem is hierarchic

Because the subsystem is hierarchical, it enables the use of timing constraints from the infrastructure cores. The subsystem automatically picks up the constraints from the sub cores.The timing constraints related to MII, GMII, RGMII interfaces are provided by Tri-Mode Ethernet MAC core. The timing constraints related to VLAN and others are provided by the AXI Ethernet Buffer. The timing constraints related to the transceiver and elastic buffers are provided by the 1G/2.5G Ethernet PCS/PMA or SGMII core.In addition to the sub-cores constraints, the placement constraints should be provided at the top.When a project is targeted for a board, you can use Board Based IO Constraints generation. On selection of the board interface, the constraints for that interface are generated automatically.The subsystem propagates the required inputs to the sub cores and these generate the constraints in their file list. These constraints are usually available in a file that has file name ending with _board.xdc

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由于子系统是分层的，因此它可以使用基础设施核心的时序约束。子系统自动从子核获取约束。 与 MII、GMII、RGMII 接口相关的时序约束由三模以太网 MAC 内核提供。与 VLAN 和其他相关的时序约束由 AXI 以太网缓冲区提供。与收发器和弹性缓冲器相关的时序约束由 1G/2.5G 以太网 PCS/PMA 或 SGMII 内核提供。 除了子核约束之外，还应在顶部提供布局约束。 当项目针对主板时，您可以使用基于主板的 IO 约束生成。选择板卡接口后，会自动生成该接口的约束。 子系统将所需的输入传播到子核，并在其文件列表中生成约束。这些约束通常在文件名以 _board.xdc 结尾的文件中提供

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因为子系统是分层的，所以它能够使用来自基础设施核心的定时约束。子系统自动从子核心中提取约束。 与MII、GMII、RGMII接口相关的时序约束由三模式以太网MAC核心提供。与VLAN和其他相关的定时约束由AXI以太网缓冲器提供。与收发器和弹性缓冲器相关的时序约束由1G/2.5G以太网PCS/PMA或SGMII核心提供。 除了子型芯约束外，还应在顶部提供放置约束。 当项目的目标是板时，可以使用基于板的IO约束生成。在选择板接口时，会自动生成该接口的约束。 子系统将所需的输入传播到子核心，这些子核心在其文件列表中生成约束。这些约束通常在文件名以结尾的文件中可用

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因为子系统是分层的，所以它支持使用基础设施核心的时序约束。子系统自动从子内核中选取约束。 与MII、GMII、RGMII接口相关的时序约束由三模式以太网MAC核心提供。与VLAN等相关的时序约束由AXI以太网缓冲区提供。与收发器和弹性缓冲器相关的时序约束由1G/2.5G以太网PCS/PMA或SGMII内核提供。 除了子核心约束之外，应该在顶部提供放置约束。 当项目以电路板为目标时，您可以使用基于电路板的IO约束生成。选择电路板接口后，该接口的约束会自动生成。 子系统将所需的输入传播到子内核，这些子内核在其文件列表中生成约束。这些约束通常存在于文件名以_board.xdc结尾的文件中

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