Power-Down Mode Input PinPDB = 1, d

Power-Down Mode Input PinPDB = 1, device is enabled (normal operation )PDB = 0, device is powered down .When the device is in the POWER DOWN state, the LVCMOS outputs are intri-state,the PLL is shutdown and IDD is minimized.Note: PDB pin requires minimum ramp time of 200us

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掉电模式输入引脚 PDB = 1，设备被启用（正常操作） PDB = 0，设备掉电。 当该装置处于断电状态时，LVCMOS输出intri状态时， PLL被关机和IDD被最小化。 注：PDB引脚需要200US的最小斜坡时间

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Power-Down Mode Input Pin PDB = 1, device is enabled (normal operation ) PDB = 0, device is powered down . When the device is in the POWER DOWN state, the LVCMOS outputs are intri-state, the PLL is shutdown and IDD is minimized. Note: PDB pin requires minimum ramp time of 200us

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断电模式输入引脚 PDB=1，设备已启用（正常运行） PDB=0，设备断电。 当设备处于断电状态时，LVCMOS输出为intri状态， PLL关闭，IDD最小化。 注：PDB引脚要求最小斜坡时间为200us

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