Figure 30 shows the serial interface between the AD9832 and the 80C51/的简体中文翻译

Figure 30 shows the serial interfac

Figure 30 shows the serial interface between the AD9832 and the 80C51/80L51 microcontroller. The microcontroller operates in Mode 0 so that TXD of the 80C51/80L51 drives SCLK of the AD9832, while RXD drives the serial data line SDATA. The FSYNC signal is again derived from a bit programmable pin on the port (P3.3 being used in the diagram). When data is transmitted to the AD9832, P3.3 is taken low. The 80C51/80L51 transmits data in 8-bit bytes; therefore, only 8 falling SCLK edges occur in each cycle. To load the remaining 8 bits to the AD9832, P3.3 is held low after the first 8 bits have been transmitted and a second
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图 30 显示了 AD9832 和 80C51/80L51 微控制器之间的串行接口<br>。微控制器工作<br>在模式0,因此80C51/80L51的TXD驱动AD9832的SCLK <br>,而RXD驱动串行数据线SDATA。FSYNC<br>信号再次源自端口上的位可编程引脚<br>(图中使用的 P3.3)。当数据传输到<br>AD9832时,P3.3被拉低。80C51/80L51<br>以8位字节传输数据;因此,每个周期仅出现 8 个 SCLK 下降沿<br>。<br>为了将剩余的 8 位加载到 AD9832,在前 8 位传输完毕后,P3.3 保持低电平,第二个
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图30显示了AD9832和<br>80C51/80L51微控制器。微控制器运行<br>在模式0中,使得80C51/80L51的TXD驱动<br>AD9832,而RXD驱动串行数据线SDATA。FSYNC<br>信号再次来自端口上的位可编程引脚<br>(图中使用P3.3)。当数据传输到<br>AD9832、P3.3被取低。80C51/80L51传输数据<br>以8位字节为单位;因此,每个SCLK只有8个下降沿<br>周期要将剩余的8位加载到AD9832,则保持P3.3<br>在前8个比特已经被发送并且第二个比特被发送之后为低
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图30显示了AD9832与之间的串行接口<br>80C51/80L51微控制器。微控制器运行<br>在模式0下,80C51/80L51的TXD驱动的SCLK<br>AD9832,而RXD驱动串行数据线SDATA。FSYNC<br>信号同样来自端口上的位可编程引脚<br>(图中使用了P3.3)。当数据传输到<br>ad 9832 p 3.3被拉低。80C51/80L51传输数据<br>以8位字节表示;因此,每个中仅出现8个SCLK下降沿<br>循环。要将其余8位载入AD9832,需保持P3.3<br>前8位发送完毕后为低电平,第二位
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