Abstract. In this paper we evaluate

Abstract. In this paper we evaluate and improve dierent vector implementation
techniques of AES-based designs. We analyze how well
the T-table, bitsliced and bytesliced implementation techniques apply
to the SHA-3 nalist Grstl. We present a number of new Grstl implementations
that improve upon many previous results. For example,
our fastest ARM NEON implementation of Grstl is 40% faster than
the previously fastest ARM implementation. We present the rst Intel
AVX2 implementations of Grstl, which require 40% less instructions
than previous implementations. Furthermore, we present ARM CortexM0
implementations of Grstl that improve the speed by 55% or the
memory requirements by 15%.

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抽象。在本文中，我们评估和改进迪？erent载体实现 的基于AES的设计技术。我们分析如何 在T-表，bitsliced和bytesliced实现技术适用 于SHA-3 nalist的Gr？STL。我们提出了一些新的Gr？STL实现 取决于很多以前的结果改善。例如， 我们增长最快的Gr？STL的ARM NEON实现快于40％ 的先前最快的ARM实现。我们提出的第一个英特尔 的Gr？STL的AVX2实现，这就需要减少40％，说明 比以前的实现。此外，我们提出ARM CortexM0 改善了55％的速度或在GR？STL的实现 了15％的存储器需求。

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抽象。在本文中，我们评估和改进erent 矢量实现 基于AES的设计技术。我们分析 T 表、位切片和字节片实现技术的应用 到SHA-3纳斯特·格斯特尔我们介绍了许多新的 Grstl 实现 改进许多以前的结果。例如， 我们最快的 ARM NEON 实施 Grstl 比 以前最快的 ARM 实现。我们展示的 rst 英特尔 Grstl 的 AVX2 实现，需要减少 40% 的指令 比以前的实现。此外，我们介绍 ARM CortexM0 实施 Grstl，将速度提高 55% 或 内存要求为 15%。

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抽象的。在本文中，我们评估并改进了二烯向量的实现。 基于aes的设计技术。我们分析 t-table、位切片和bytesliced实现技术应用于 去SHA-3 NALIST GR STL。我们提出了一些新的gr stl实现 这比以前的许多结果都好。例如， 我们最快的ARM霓虹灯GR STL实现速度比 以前最快的arm实现。我们提供了第一份情报 GR STL的AVX2实现，所需指令减少40% 比以前的实现。此外，我们还介绍了ARM Cortexm0 gr stl的实现将速度提高了55%或 内存需求增加15%。

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